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[ARM] Assembler and disassembler support Dot Product Extension


  This patch add assembler and disassembler support for new Dot Product

  The support can be enabled through the new "+dotprod" extension.

  OK for master?

2017-06-28  Jiong Wang  <>

        * opcode/arm.h (FPU_NEON_EXT_DOTPROD): New macro.
        (FPU_ARCH_DOTPROD_NEON_VFP_ARMV8): New macro.

2017-06-28  Jiong Wang  <>

        * config/tc-arm.c (fpu_neon_ext_dotprod): New variable.
        (neon_scalar_for_mul): Improve comments.
        (do_neon_dotproduct): New function to encode Dot Product instructions.
        (do_neon_dotproduct_s): Wrapper function for signed Dot Product
        (do_neon_dotproduct_u): Wrapper function for unsigned Dot Product
        (insns): New entries for vsdot and vudot.
        (arm_extensions): New entry for "dotprod".
        * doc/c-arm.texi: Document new "dotprod" extension.
        * testsuite/gas/arm/dotprod.s: New test source.
        * testsuite/gas/arm/dotprod-illegal.s: New test source.
        * testsuite/gas/arm/dotprod.d: New test.
        * testsuite/gas/arm/dotprod-thumb2.d: New test.
        * testsuite/gas/arm/dotprod-illegal.d: New test.
        * testsuite/gas/arm/dotprod-legacy-arch.d: New test.
        * testsuite/gas/arm/dotprod-illegal.l: New error file.
        * testsuite/gas/arm/dotprod-legacy-arch.l: New error file.

2017-06-28  Jiong Wang  <>

        * arm-dis.c (coprocessor_opcodes): New entries for vsdot and vudot.

diff --git a/gas/config/tc-arm.c b/gas/config/tc-arm.c
index f0b11f4f2c772b57ab72f8736780738b2ae63253..f1d8fd09d9007f9dc9bf8ed42e921d4817ae82f2 100644
--- a/gas/config/tc-arm.c
+++ b/gas/config/tc-arm.c
@@ -294,6 +294,8 @@ static const arm_feature_set crc_ext_armv8 =
 static const arm_feature_set fpu_neon_ext_v8_1 =
+static const arm_feature_set fpu_neon_ext_dotprod =
 static int mfloat_abi_opt = -1;
 /* Record user cpu selection for object attributes.  */
@@ -15023,7 +15025,14 @@ do_neon_ceq (void)
    scalars, which are encoded in 5 bits, M : Rm.
    For 16-bit scalars, the register is encoded in Rm[2:0] and the index in
    M:Rm[3], and for 32-bit scalars, the register is encoded in Rm[3:0] and the
-   index in M.  */
+   index in M.
+   Dot Product instructions are similar to multiply instructions except elsize
+   should always be 32.
+   This function translates SCALAR, which is GAS's internal encoding of indexed
+   scalar register, to raw encoding.  There is also register and index range
+   check based on ELSIZE.  */
 static unsigned
 neon_scalar_for_mul (unsigned scalar, unsigned elsize)
@@ -17365,6 +17374,79 @@ do_vcadd (void)
   inst.instruction |= (size == 32) << 20;
+/* Dot Product instructions encoding support.  */
+static void
+do_neon_dotproduct (int unsigned_p)
+  enum neon_shape rs;
+  unsigned scalar_oprd2 = 0;
+  int high8;
+  if (inst.cond != COND_ALWAYS)
+    as_warn (_("Dot Product instructions cannot be conditional,  the behaviour "
+	       "is UNPREDICTABLE"));
+  constraint (!ARM_CPU_HAS_FEATURE (cpu_variant, fpu_neon_ext_armv8),
+	      _(BAD_FPU));
+  /* Dot Product instructions are in three-same D/Q register format or the third
+     operand can be a scalar index register.  */
+  if (inst.operands[2].isscalar)
+    {
+      scalar_oprd2 = neon_scalar_for_mul (inst.operands[2].reg, 32);
+      high8 = 0xfe000000;
+      rs = neon_select_shape (NS_DDS, NS_QQS, NS_NULL);
+    }
+  else
+    {
+      high8 = 0xfc000000;
+      rs = neon_select_shape (NS_DDD, NS_QQQ, NS_NULL);
+    }
+  if (unsigned_p)
+    neon_check_type (3, rs, N_EQK, N_EQK, N_KEY | N_U8);
+  else
+    neon_check_type (3, rs, N_EQK, N_EQK, N_KEY | N_S8);
+  /* The "U" bit in traditional Three Same encoding is fixed to 0 for Dot
+     Product instruction, so we pass 0 as the "ubit" parameter.  And the
+     "Size" field are fixed to 0x2, so we pass 32 as the "size" parameter.  */
+  neon_three_same (neon_quad (rs), 0, 32);
+  /* Undo neon_dp_fixup.  Dot Product instructions are using a slightly
+     different NEON three-same encoding.  */
+  inst.instruction &= 0x00ffffff;
+  inst.instruction |= high8;
+  /* Encode 'U' bit which indicates signedness.  */
+  inst.instruction |= (unsigned_p ? 1 : 0) << 4;
+  /* Re-encode operand2 if it's indexed scalar operand.  What has been encoded
+     from inst.operand[2].reg in neon_three_same is GAS's internal encoding, not
+     the instruction encoding.  */
+  if (inst.operands[2].isscalar)
+    {
+      inst.instruction &= 0xffffffd0;
+      inst.instruction |= LOW4 (scalar_oprd2);
+      inst.instruction |= HI1 (scalar_oprd2) << 5;
+    }
+/* Dot Product instructions for signed integer.  */
+static void
+do_neon_dotproduct_s (void)
+  return do_neon_dotproduct (0);
+/* Dot Product instructions for unsigned integer.  */
+static void
+do_neon_dotproduct_u (void)
+  return do_neon_dotproduct (1);
 /* Crypto v1 instructions.  */
 static void
 do_crypto_2op_1 (unsigned elttype, int op)
@@ -19914,6 +19996,13 @@ static const struct asm_opcode insns[] =
  NUF (vcadd, 0, 4, (RNDQ, RNDQ, RNDQ, EXPi), vcadd),
 #undef  ARM_VARIANT
+#define ARM_VARIANT   & fpu_neon_ext_dotprod
+#define THUMB_VARIANT & fpu_neon_ext_dotprod
+ NUF (vsdot, d00, 3, (RNDQ, RNDQ, RNDQ_RNSC), neon_dotproduct_s),
+ NUF (vudot, d00, 3, (RNDQ, RNDQ, RNDQ_RNSC), neon_dotproduct_u),
+#undef  ARM_VARIANT
 #define ARM_VARIANT  & fpu_fpa_ext_v1  /* Core FPA instruction set (V1).  */
@@ -25950,6 +26039,9 @@ static const struct arm_option_extension_value_table arm_extensions[] =
+			  ARM_ARCH_V8_2A),
diff --git a/gas/doc/c-arm.texi b/gas/doc/c-arm.texi
index 31a012ea1b754b1a1c4f7ac8c2a2ee129abfe208..15c3acd8d8173245bcf4d6e885652d7c6d238571 100644
--- a/gas/doc/c-arm.texi
+++ b/gas/doc/c-arm.texi
@@ -174,6 +174,7 @@ been added, again in ascending alphabetical order.  For example,
 The following extensions are currently supported:
 @code{crypto} (Cryptography Extensions for v8-A architecture, implies @code{fp+simd}),
+@code{dotprod} (Dot Product Extensions for v8.2-A architecture, implies @code{fp+simd}),
 @code{fp} (Floating Point Extensions for v8-A architecture),
 @code{idiv} (Integer Divide Extensions for v7-A and v7-R architectures),
diff --git a/gas/testsuite/gas/arm/dotprod-illegal.d b/gas/testsuite/gas/arm/dotprod-illegal.d
new file mode 100644
index 0000000000000000000000000000000000000000..f75450cda3acbbc25178c110b938e393e1fd3286
--- /dev/null
+++ b/gas/testsuite/gas/arm/dotprod-illegal.d
@@ -0,0 +1,2 @@
+#as: -march=armv8.2-a+dotprod -mfpu=neon-fp-armv8
+#error-output: dotprod-illegal.l
diff --git a/gas/testsuite/gas/arm/dotprod-illegal.l b/gas/testsuite/gas/arm/dotprod-illegal.l
new file mode 100644
index 0000000000000000000000000000000000000000..5b88bc3002b9516956822f5604e33261d164722b
--- /dev/null
+++ b/gas/testsuite/gas/arm/dotprod-illegal.l
@@ -0,0 +1,10 @@
+[^:]*: Assembler messages:
+[^:]*:4: Error: bad type in Neon instruction -- `vudot.s8 d0,d2,d5'
+[^:]*:6: Error: bad type in Neon instruction -- `vudot.u16 d0,d2,d5'
+[^:]*:7: Error: bad type in Neon instruction -- `vsdot.s16 d1,d12,d18'
+[^:]*:9: Error: bad type in Neon instruction -- `vudot.u32 d2,d22,d1'
+[^:]*:10: Error: bad type in Neon instruction -- `vsdot.s32 d3,d30,d9'
+[^:]*:12: Error: scalar out of range for multiply instruction -- `vudot.u8 d31,d2,d16\[0\]'
+[^:]*:13: Error: scalar out of range for multiply instruction -- `vsdot.s8 q13,q14,d22\[1\]'
+[^:]*:15: Error: scalar out of range for multiply instruction -- `vudot.u8 d1,d8,d15\[2\]'
+[^:]*:16: Error: scalar out of range for multiply instruction -- `vsdot.s8 q14,q7,d15\[3\]'
diff --git a/gas/testsuite/gas/arm/dotprod-illegal.s b/gas/testsuite/gas/arm/dotprod-illegal.s
new file mode 100644
index 0000000000000000000000000000000000000000..8b785911174a6d0e4a87f0c504efbd2ac1f2bfcd
--- /dev/null
+++ b/gas/testsuite/gas/arm/dotprod-illegal.s
@@ -0,0 +1,16 @@
+	.text
+	# name and suffix mismatch.
+	vudot.s8	d0, d2, d5
+	# No .*16 suffix support.
+	vudot.u16	d0, d2, d5
+	vsdot.s16	d1, d12, d18
+	# No .*32 suffix support.
+	vudot.u32	d2, d22, d1
+	vsdot.s32	d3, d30, d9
+	# Scalar base register out of bound
+	vudot.u8	d31, d2, d16[0]
+	vsdot.s8	q13, q14, d22[1]
+	# Scalar index out of bound
+	vudot.u8	d1, d8, d15[2]
+	vsdot.s8	q14, q7, d15[3]
diff --git a/gas/testsuite/gas/arm/dotprod-legacy-arch.d b/gas/testsuite/gas/arm/dotprod-legacy-arch.d
new file mode 100644
index 0000000000000000000000000000000000000000..9f8750361f1f51e0ddfa33ed23efa8018e7b8aac
--- /dev/null
+++ b/gas/testsuite/gas/arm/dotprod-legacy-arch.d
@@ -0,0 +1,3 @@
+#as: -march=armv8.1-a+dotprod -mfpu=neon-fp-armv8
+#source: dotprod.s
+#error-output: dotprod-legacy-arch.l
diff --git a/gas/testsuite/gas/arm/dotprod-legacy-arch.l b/gas/testsuite/gas/arm/dotprod-legacy-arch.l
new file mode 100644
index 0000000000000000000000000000000000000000..a627a36fb12b0e698a90d91da6506627c93ea45b
--- /dev/null
+++ b/gas/testsuite/gas/arm/dotprod-legacy-arch.l
@@ -0,0 +1,3 @@
+Assembler messages:
+[^:]*: extension does not apply to the base architecture
+[^:]*: unrecognized option -march=armv8.1-a\+dotprod
diff --git a/gas/testsuite/gas/arm/dotprod-thumb2.d b/gas/testsuite/gas/arm/dotprod-thumb2.d
new file mode 100644
index 0000000000000000000000000000000000000000..9b558a65aa49f8263914476f11a5978880e0c9ad
--- /dev/null
+++ b/gas/testsuite/gas/arm/dotprod-thumb2.d
@@ -0,0 +1,297 @@
+#as: -march=armv8.2-a+dotprod -mfpu=neon-fp-armv8 -mthumb
+#source: dotprod.s
+#objdump: -d
+.*: +file format .*arm.*
+Disassembly of section .text:
+.* <.*>:
+.*:	fc22 0d10 	vudot.u8	d0, d2, d0
+.*:	fe22 0d10 	vudot.u8	d0, d2, d0\[0\]
+.*:	fc22 0d18 	vudot.u8	d0, d2, d8
+.*:	fe22 0d18 	vudot.u8	d0, d2, d8\[0\]
+.*:	fc22 0d1f 	vudot.u8	d0, d2, d15
+.*:	fe22 0d1f 	vudot.u8	d0, d2, d15\[0\]
+.*:	fc2f 0d10 	vudot.u8	d0, d15, d0
+.*:	fe2f 0d10 	vudot.u8	d0, d15, d0\[0\]
+.*:	fc2f 0d18 	vudot.u8	d0, d15, d8
+.*:	fe2f 0d18 	vudot.u8	d0, d15, d8\[0\]
+.*:	fc2f 0d1f 	vudot.u8	d0, d15, d15
+.*:	fe2f 0d1f 	vudot.u8	d0, d15, d15\[0\]
+.*:	fc2e 0d90 	vudot.u8	d0, d30, d0
+.*:	fe2e 0d90 	vudot.u8	d0, d30, d0\[0\]
+.*:	fc2e 0d98 	vudot.u8	d0, d30, d8
+.*:	fe2e 0d98 	vudot.u8	d0, d30, d8\[0\]
+.*:	fc2e 0d9f 	vudot.u8	d0, d30, d15
+.*:	fe2e 0d9f 	vudot.u8	d0, d30, d15\[0\]
+.*:	fc22 7d10 	vudot.u8	d7, d2, d0
+.*:	fe22 7d10 	vudot.u8	d7, d2, d0\[0\]
+.*:	fc22 7d18 	vudot.u8	d7, d2, d8
+.*:	fe22 7d18 	vudot.u8	d7, d2, d8\[0\]
+.*:	fc22 7d1f 	vudot.u8	d7, d2, d15
+.*:	fe22 7d1f 	vudot.u8	d7, d2, d15\[0\]
+.*:	fc2f 7d10 	vudot.u8	d7, d15, d0
+.*:	fe2f 7d10 	vudot.u8	d7, d15, d0\[0\]
+.*:	fc2f 7d18 	vudot.u8	d7, d15, d8
+.*:	fe2f 7d18 	vudot.u8	d7, d15, d8\[0\]
+.*:	fc2f 7d1f 	vudot.u8	d7, d15, d15
+.*:	fe2f 7d1f 	vudot.u8	d7, d15, d15\[0\]
+.*:	fc2e 7d90 	vudot.u8	d7, d30, d0
+.*:	fe2e 7d90 	vudot.u8	d7, d30, d0\[0\]
+.*:	fc2e 7d98 	vudot.u8	d7, d30, d8
+.*:	fe2e 7d98 	vudot.u8	d7, d30, d8\[0\]
+.*:	fc2e 7d9f 	vudot.u8	d7, d30, d15
+.*:	fe2e 7d9f 	vudot.u8	d7, d30, d15\[0\]
+.*:	fc62 0d10 	vudot.u8	d16, d2, d0
+.*:	fe62 0d10 	vudot.u8	d16, d2, d0\[0\]
+.*:	fc62 0d18 	vudot.u8	d16, d2, d8
+.*:	fe62 0d18 	vudot.u8	d16, d2, d8\[0\]
+.*:	fc62 0d1f 	vudot.u8	d16, d2, d15
+.*:	fe62 0d1f 	vudot.u8	d16, d2, d15\[0\]
+.*:	fc6f 0d10 	vudot.u8	d16, d15, d0
+.*:	fe6f 0d10 	vudot.u8	d16, d15, d0\[0\]
+.*:	fc6f 0d18 	vudot.u8	d16, d15, d8
+.*:	fe6f 0d18 	vudot.u8	d16, d15, d8\[0\]
+.*:	fc6f 0d1f 	vudot.u8	d16, d15, d15
+.*:	fe6f 0d1f 	vudot.u8	d16, d15, d15\[0\]
+.*:	fc6e 0d90 	vudot.u8	d16, d30, d0
+.*:	fe6e 0d90 	vudot.u8	d16, d30, d0\[0\]
+.*:	fc6e 0d98 	vudot.u8	d16, d30, d8
+.*:	fe6e 0d98 	vudot.u8	d16, d30, d8\[0\]
+.*:	fc6e 0d9f 	vudot.u8	d16, d30, d15
+.*:	fe6e 0d9f 	vudot.u8	d16, d30, d15\[0\]
+.*:	fc62 fd10 	vudot.u8	d31, d2, d0
+.*:	fe62 fd10 	vudot.u8	d31, d2, d0\[0\]
+.*:	fc62 fd18 	vudot.u8	d31, d2, d8
+.*:	fe62 fd18 	vudot.u8	d31, d2, d8\[0\]
+.*:	fc62 fd1f 	vudot.u8	d31, d2, d15
+.*:	fe62 fd1f 	vudot.u8	d31, d2, d15\[0\]
+.*:	fc6f fd10 	vudot.u8	d31, d15, d0
+.*:	fe6f fd10 	vudot.u8	d31, d15, d0\[0\]
+.*:	fc6f fd18 	vudot.u8	d31, d15, d8
+.*:	fe6f fd18 	vudot.u8	d31, d15, d8\[0\]
+.*:	fc6f fd1f 	vudot.u8	d31, d15, d15
+.*:	fe6f fd1f 	vudot.u8	d31, d15, d15\[0\]
+.*:	fc6e fd90 	vudot.u8	d31, d30, d0
+.*:	fe6e fd90 	vudot.u8	d31, d30, d0\[0\]
+.*:	fc6e fd98 	vudot.u8	d31, d30, d8
+.*:	fe6e fd98 	vudot.u8	d31, d30, d8\[0\]
+.*:	fc6e fd9f 	vudot.u8	d31, d30, d15
+.*:	fe6e fd9f 	vudot.u8	d31, d30, d15\[0\]
+.*:	fc22 0d00 	vsdot.s8	d0, d2, d0
+.*:	fe22 0d00 	vsdot.s8	d0, d2, d0\[0\]
+.*:	fc22 0d08 	vsdot.s8	d0, d2, d8
+.*:	fe22 0d08 	vsdot.s8	d0, d2, d8\[0\]
+.*:	fc22 0d0f 	vsdot.s8	d0, d2, d15
+.*:	fe22 0d0f 	vsdot.s8	d0, d2, d15\[0\]
+.*:	fc2f 0d00 	vsdot.s8	d0, d15, d0
+.*:	fe2f 0d00 	vsdot.s8	d0, d15, d0\[0\]
+.*:	fc2f 0d08 	vsdot.s8	d0, d15, d8
+.*:	fe2f 0d08 	vsdot.s8	d0, d15, d8\[0\]
+.*:	fc2f 0d0f 	vsdot.s8	d0, d15, d15
+.*:	fe2f 0d0f 	vsdot.s8	d0, d15, d15\[0\]
+.*:	fc2e 0d80 	vsdot.s8	d0, d30, d0
+.*:	fe2e 0d80 	vsdot.s8	d0, d30, d0\[0\]
+.*:	fc2e 0d88 	vsdot.s8	d0, d30, d8
+.*:	fe2e 0d88 	vsdot.s8	d0, d30, d8\[0\]
+.*:	fc2e 0d8f 	vsdot.s8	d0, d30, d15
+.*:	fe2e 0d8f 	vsdot.s8	d0, d30, d15\[0\]
+.*:	fc22 7d00 	vsdot.s8	d7, d2, d0
+.*:	fe22 7d00 	vsdot.s8	d7, d2, d0\[0\]
+.*:	fc22 7d08 	vsdot.s8	d7, d2, d8
+.*:	fe22 7d08 	vsdot.s8	d7, d2, d8\[0\]
+.*:	fc22 7d0f 	vsdot.s8	d7, d2, d15
+.*:	fe22 7d0f 	vsdot.s8	d7, d2, d15\[0\]
+.*:	fc2f 7d00 	vsdot.s8	d7, d15, d0
+.*:	fe2f 7d00 	vsdot.s8	d7, d15, d0\[0\]
+.*:	fc2f 7d08 	vsdot.s8	d7, d15, d8
+.*:	fe2f 7d08 	vsdot.s8	d7, d15, d8\[0\]
+.*:	fc2f 7d0f 	vsdot.s8	d7, d15, d15
+.*:	fe2f 7d0f 	vsdot.s8	d7, d15, d15\[0\]
+.*:	fc2e 7d80 	vsdot.s8	d7, d30, d0
+.*:	fe2e 7d80 	vsdot.s8	d7, d30, d0\[0\]
+.*:	fc2e 7d88 	vsdot.s8	d7, d30, d8
+.*:	fe2e 7d88 	vsdot.s8	d7, d30, d8\[0\]
+.*:	fc2e 7d8f 	vsdot.s8	d7, d30, d15
+.*:	fe2e 7d8f 	vsdot.s8	d7, d30, d15\[0\]
+.*:	fc62 0d00 	vsdot.s8	d16, d2, d0
+.*:	fe62 0d00 	vsdot.s8	d16, d2, d0\[0\]
+.*:	fc62 0d08 	vsdot.s8	d16, d2, d8
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diff --git a/gas/testsuite/gas/arm/dotprod.d b/gas/testsuite/gas/arm/dotprod.d
new file mode 100644
index 0000000000000000000000000000000000000000..c927f0b09f3f78e895426fe524a2e49f0379d0a3
--- /dev/null
+++ b/gas/testsuite/gas/arm/dotprod.d
@@ -0,0 +1,297 @@
+#no fpu options passed, we expect dotprod to imply simd+fp
+#as: -march=armv8.2-a+dotprod
+#objdump: -d
+.*: +file format .*arm.*
+Disassembly of section .text:
+.* <.*>:
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new file mode 100644
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+++ b/gas/testsuite/gas/arm/dotprod.s
@@ -0,0 +1,44 @@
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+	.endr
+	.endm
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+		dotprod_iter_d_n \op, \d, \n
+	.endr
+	.endm
+	.macro dotprod_iter op
+	.irp d, 0, 7, 16, 31
+		dotprod_iter_d \op, \d
+	.endr
+	.endm
+	.macro dotprod_q_iter_d_n op, d, n
+	.irp m, 0, 7, 15
+		\op q\d, q\n, q\m
+		\op q\d, q\n, d\m[1]
+	.endr
+	.endm
+	.macro dotprod_q_iter_d op, d
+	.irp n, 2, 3, 14
+		dotprod_q_iter_d_n \op, \d, \n
+	.endr
+	.endm
+	.macro dotprod_q_iter op
+	.irp d, 0, 1, 6, 13
+		dotprod_q_iter_d \op, \d
+	.endr
+	.endm
+	.text
+	dotprod_iter vudot.u8
+	dotprod_iter vsdot.s8
+	dotprod_q_iter vudot.u8
+	dotprod_q_iter vsdot.s8
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--- a/include/opcode/arm.h
+++ b/include/opcode/arm.h
@@ -93,7 +93,8 @@
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 #define CRC_EXT_ARMV8	 0x00004000	/* CRC32 for ARMv8.  */
 #define FPU_VFP_EXT_ARMV8xD 0x00002000	/* Single-precision FP for ARMv8.  */
-#define FPU_NEON_EXT_RDMA 0x00001000     /* v8.1 Adv.SIMD extensions.  */
+#define FPU_NEON_EXT_RDMA 0x00001000	/* v8.1 Adv.SIMD extensions.  */
+#define FPU_NEON_EXT_DOTPROD 0x00000800	/* Dot Product extension.  */
 /* Architectures are the sum of the base and extensions.  The ARM ARM (rev E)
    defines the following: ARMv3, ARMv3M, ARMv4xM, ARMv4, ARMv4TxM, ARMv4T,
@@ -234,6 +235,8 @@
 		      | FPU_NEON_EXT_RDMA)
diff --git a/opcodes/arm-dis.c b/opcodes/arm-dis.c
index a30afb9a7ee482cb9204cdac6faf5dc9e59a09c1..582383440192a1cd38bd4c508703b4ccc38df7c4 100644
--- a/opcodes/arm-dis.c
+++ b/opcodes/arm-dis.c
@@ -902,6 +902,12 @@ static const struct opcode32 coprocessor_opcodes[] =
     0xfea00800, 0xffa00f10, "vcmla%c.f32\t%12-15,22V, %16-19,7V, %0-3,5D[0], #%20?21%20?780"},
+  /* Dot Product instructions in the space of coprocessor 13.  */
+    0xfc200d00, 0xffb00f00, "v%4?usdot.%4?us8\t%12-15,22V, %16-19,7V, %0-3,5V"},
+    0xfe000d00, 0xff000f00, "v%4?usdot.%4?us8\t%12-15,22V, %16-19,7V, %0-3D[%5?10]"},
   /* V5 coprocessor instructions.  */
     0xfc100000, 0xfe100000, "ldc2%22'l%c\t%8-11d, cr%12-15d, %A"},

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